题目内容
（请给出正确答案）
[主观题]
用D触发器(上升沿)和必要的与非门设计一个同步分频器且具有自启动功能,分频器输出端为Z,当控制
用D触发器（上升沿)和必要的与非门设计一个同步分频器且具有自启动功能,分频器输出端为Z,当控制
端M=0时为5分频输出;当控制端M=1时为7分频输出.采用自然二进制状态编码且用最简电路实现.
要求:(1)画出状态图;(2)写出驱动方程;(3)画出逻辑电路图
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第2题
用维持阻塞D触发器设计一个同步计数器，计数器的输出Q3Q 2Q1的状态. 转换关系如图
用维持阻塞D触发器设计一个同步计数器，计数器的输出Q3Q2Q1的状态. 转换关系如图
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用维持阻塞D触发器设计一个同步计数器，计数器的输出Q3Q2Q1的状态.
转换关系如图5-99所示。要求:
(1)列出状态表
(2)求出最简驱动方程;:
(3)西出逻辑电路图;
(4)检查能否自启动，如果不能自启动，修改电路。
第7题
图P5.11(a)是带有异步置零端的上升沿触发D触发器，CLK、RD和D端的电压波形如图P5.11(b)中所给出。试
图P5.11（a)是带有异步置零端的上升沿触发D触发器，CLK、RD和D端的电压波形如图P5.11（b)中所给出。试
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画出触发器输出端Q对应的电压波形。
第9题
用边沿JK触发器设计一个同步三进制减法计数器，状态图如图5-95所示.试回答下列问题: (1)最少用
用边沿JK触发器设计一个同步三进制减法计数器，状态图如图5-95所示.试回答下列问题: （1)最少用
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用边沿JK触发器设计一个同步三进制减法计数器，状态图如图5-95所示.试回答下列问题:
(1)最少用几个触发器？
(2)列出状态表;
(3)求出最简驱动方程:
(4)画出逻辑电路图;
(5)检查能否自启动。
第10题
如题 图所示电路,其中边沿 D 触发器中的 R 、 S 为直接清零端和直接置 1 端,高电平有效,触发器的初始状态为 0 。则当 CP 时钟第 6 个上升沿触发后,触发器的状态 为（）
A.1110
B.0111
C.0011
D.1100
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