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[主观题]

用前沿翻转D触发器和门电路设置一个减法计数器,要求其状态图按图10.82所示变化,列出各触发器的

驱动方程,画出逻辑线路图.(不考虑自启动能力)

用前沿翻转D触发器和门电路设置一个减法计数器,要求其状态图按图10.82所示变化,列出各触发器的驱动

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第1题

用边沿JK触发器设计一个同步三进制减法计数器,状态图如图5-95所示.试回答下列问题: (1)最少用
用边沿JK触发器设计一个同步三进制减法计数器,状态图如图5-95所示.试回答下列问题: (1)最少用

用边沿JK触发器设计一个同步三进制减法计数器,状态图如图5-95所示.试回答下列问题:

(1)最少用几个触发器?

(2)列出状态表;

(3)求出最简驱动方程:

(4)画出逻辑电路图;

(5)检查能否自启动。

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第2题

试分析如图5-66所示的时序逻辑电路,要求: (1)列出驱动方程; (2)列出状态方程;. (3)列出状态
试分析如图5-66所示的时序逻辑电路,要求: (1)列出驱动方程; (2)列出状态方程;. (3)列出状态

试分析如图5-66所示的时序逻辑电路,要求:

(1)列出驱动方程;

(2)列出状态方程;.

(3)列出状态表;

(4)画出状态图;

(5)画出在CP脉冲作用下三个触发器的状态信号和Z的波形图,设三个触发器的初态均为0。

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第3题

计数器电路如图题7.3所示。设各触发器的初始状态均为“0”,要求:(1) 写出各触发器的驱动方程和次
计数器电路如图题7.3所示。设各触发器的初始状态均为“0”,要求:(1) 写出各触发器的驱动方程和次

计数器电路如图题7.3所示。设各触发器的初始状态均为“0”,要求:

(1) 写出各触发器的驱动方程和次态方程;

(2)画出次态卡诺图;画出状态转换图并说明该计数器电路的逻辑功能;

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第4题

用维持阻塞D触发器设计一个同步计数器,计数器的输出Q3Q 2Q1的状态. 转换关系如图
用维持阻塞D触发器设计一个同步计数器,计数器的输出Q3Q2Q1的状态. 转换关系如图

用维持阻塞D触发器设计一个同步计数器,计数器的输出Q3Q2Q1的状态.

转换关系如图5-99所示。要求:

(1)列出状态表

(2)求出最简驱动方程;:

(3)西出逻辑电路图;

(4)检查能否自启动,如果不能自启动,修改电路。

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第5题

用D触发器和门电路设计一个3位循环码计数器,它的编码表及转换顺序如表T6.6所示。

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第6题

分析图11-61a、b所示时序逻辑电路,试求: (1) 写出电路的输出方程、驱动方程和状态方程;(2)列出
分析图11-61a、b所示时序逻辑电路,试求: (1) 写出电路的输出方程、驱动方程和状态方程;(2)列出

逻辑状态表,画出波形图。设各触发器初始状态为0。

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第7题

图11-60所示为主从型JK触发器组成的时序逻辑电路,试求: (1)写出电路的输出方程、驱动方程和状
图11-60所示为主从型JK触发器组成的时序逻辑电路,试求: (1)写出电路的输出方程、驱动方程和状

态方程;(2)列出A=1时的逻辑状态表,画出波形图(4个脉冲);(3) 若A=0,电路的工作情况如何?设各触发器初始状态为0。

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第8题

分析图题6.2.5所示同步时序电路,写出各触发器的激励方程、电路的状态方程组和输出方程,画出状态
表和状态图。

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第9题

由负边沿JK,触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1)写出电路的
由负边沿JK,触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1)写出电路的

输出方程、驱动方程和状态方程;(2)列出A=1时的状态转换表,画出波形图(画4个CP);(3)若A=0,则电路的工作情况如何?

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第10题

图21.53是由主从型JK触发器组成的4位二进制计数器。试改变级间的连接方法,画出也是由该触发器组
成的4位二进制减法计数器,并列出其状态表。在工作之前先清零,使各个触发器的输出端Q0~Q3均为“0”。

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