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[主观题]

由负边沿JK,触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1)写出电路的

由负边沿JK,触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1)写出电路的

输出方程、驱动方程和状态方程;(2)列出A=1时的状态转换表,画出波形图(画4个CP);(3)若A=0,则电路的工作情况如何?

由负边沿JK,触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1

由负边沿JK,触发器F1和F0组成的时序逻辑电路如图4.21(a)(教材图4.18)所示。试求:(1

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第1题

已知负边沿触发的 JK触发器的J、K和CP波形如图4. 16(教材图4.13)所示,试画出输出Q的波形图。设初
已知负边沿触发的 JK触发器的J、K和CP波形如图4. 16(教材图4.13)所示,试画出输出Q的波形图。设初

始状态Q=1。

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第2题

图11-60所示为主从型JK触发器组成的时序逻辑电路,试求: (1)写出电路的输出方程、驱动方程和状
图11-60所示为主从型JK触发器组成的时序逻辑电路,试求: (1)写出电路的输出方程、驱动方程和状

态方程;(2)列出A=1时的逻辑状态表,画出波形图(4个脉冲);(3) 若A=0,电路的工作情况如何?设各触发器初始状态为0。

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第3题

试用边沿JK触发器设计一个时序逻辑电路,要求该电路的输出Z与CP之间的关系应满足图10.21所示的
波形图.

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第4题

由D触发器和边沿JK触发器组成的电路如图11-58a所示,各输入端波形如图11- 58b所示。当各触发器
的初态为“0”时,试画出Q1和Q2端的波形,并说明此电路的功能。

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第5题

试分析图4.23(a)(教材图4.20)所示时序逻辑电路的工作情况,(包括驱动方程、状态方程、状态转换表
试分析图4.23(a)(教材图4.20)所示时序逻辑电路的工作情况,(包括驱动方程、状态方程、状态转换表

和波形图) ,设触发器F1和F0的初始状态Q1Q0=00。

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第6题

在CP下降沿触发的边沿JK触发器中,CP、J、K的波形如图P4.4所示试对应画出的波形触发器起始状态为0

在CP下降沿触发的边沿JK触发器中,CP、J、K的波形如图P4.4所示试对应画出的波形触发器起始状态为0.

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第7题

在图P4.7(a)所示各电路中,FF1~FF4均为边沿触发器:(1)写出各个触发器次态输出的函数表
在图P4.7(a)所示各电路中,FF1~FF4均为边沿触发器:(1)写出各个触发器次态输出的函数表

在图P4.7(a)所示各电路中,FF1~FF4均为边沿触发器:

(1)写出各个触发器次态输出的函数表达式;

(2)CP及A、B、C的波形如图P4.7(b)所示,试对应鶯出各电路Q端的波形.

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第8题

已知下降沿有效的边沿JK触发器CP、J、K及异步置1端 、异步置0端的波形如图10.3所示,试画出Q的波形

已知下降沿有效的边沿JK触发器CP、J、K及异步置1端、异步置0端的波形如图10.3所示,试画出Q的波形(设Q的初态为0).

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第9题

分析图11-61a、b所示时序逻辑电路,试求: (1) 写出电路的输出方程、驱动方程和状态方程;(2)列出
分析图11-61a、b所示时序逻辑电路,试求: (1) 写出电路的输出方程、驱动方程和状态方程;(2)列出

逻辑状态表,画出波形图。设各触发器初始状态为0。

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第10题

图4.18(教材图4.15)所示的逻辑电路能将D触发器转换成JK触发器,试证明之。
图4.18(教材图4.15)所示的逻辑电路能将D触发器转换成JK触发器,试证明之。

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