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[主观题]

给出下列器件: 74LS194、74LS169、74LS161、74LS151及少量门电路,试设计一个输出序列为01001100010111的序列信号发生器。(1)采用反馈移位型结构实现电路。(2)采用计数型结构实现电路。

给出下列器件: 74LS194、74LS169、74LS161、74LS151及少量门电路,试设计一个输出序列为01001100010111的序列信号发生器。(1)采用反馈移位型结构实现电路。(2)采用计数型结构实现电路。

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第1题

设输入序列为1,2,…,n,编写一个算法,判断一个序列p1,p2,...,pn,是否是一个合理的输出序列。

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第3题

有两组TTL与非门器件,分别测得它们的技术参数如下:试分别求出它们的噪声容限,并判断哪组门电路

有两组TTL与非门器件,分别测得它们的技术参数如下:

试分别求出它们的噪声容限,并判断哪组门电路的抗干扰能力强。

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第4题

74LS163加必要的门电路是否可构成5进制计数器?序列为2,3,4,5,6?()
74LS163加必要的门电路是否可构成5进制计数器?序列为2,3,4,5,6?()

A.是

B.否

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第5题

若周期序列为实数序列,则呈共轭对称性,即试证明此特性.

若周期序列为实数序列,则呈共轭对称性,即试证明此特性.

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第6题

设栈的输人序列为1,2,…,n,输出序列为p1,P2,…,pn,若pk=n(1≤k≤n),则当k≤i≤n时p1
设栈的输人序列为1,2,…,n,输出序列为p1,P2,…,pn,若pk=n(1≤k≤n),则当k≤i≤n时p1

为()。

A、n-i

B、n-i+1

C、n-i+k

D、不确定

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第7题

试选用MSI器件设计一个可逆计数器,X为控制端。要求:当X=0时,计数范围如下:当X=1时,计数范围如

试选用MSI器件设计一个可逆计数器,X为控制端。要求:

当X=0时,计数范围如下:

当X=1时,计数范围如下:

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第8题

已知信码序列为1011 0000 0000 0101,试确定相应的AMI码及HDB3码,并分别画出它们的波形图

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第9题

‏由静态CMOS反相器的动态特性可知,一个快速门的设计是通过()实现的。

A.减小输出电容或减小器件的W/L实现的

B.增大输出电容或加大器件的W/L实现的

C.减小输出电容或加大器件的W/L实现的

D.增大输出电容或减小器件的W/L实现的

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第10题

使用同步二进制计数器74LS161及必要的门电路设计一个模100计数器.

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