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[主观题]

设计一个时序电路，它有两个输入X1和X0、一个输出Z0只有当X1;输入三个(或三个以上)1后，X0再输入一个1时，输出Z为1,而在同一时刻两个输入不同时为1,一旦Z=1,电路就回到原始状态。这里，X1输入三个1并不要求连续，只要其间没有X0=1插人即可。

设计一个时序电路，它有两个输入X1和X0、一个输出Z0只有当X1;输入三个（或三个以上)1后，X0再输入一个1时，输出Z为1,而在同一时刻两个输入不同时为1,一旦Z=1,电路就回到原始状态。这里，X1输入三个1并不要求连续，只要其间没有X0=1插人即可。

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第1题

设计一个基本型异步时序电路，输入x₁，x₂。功输出二如果输入变量个数按二进制增加，则输出为1，反之输出为0，所谓按二进制增加是指x₁，x₂=00→01→11或00→10→11。

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第2题

试用双4选1数据选择器74153和少量门设计一个有4个输入X₃、X₂、X₁、X₀和2个输出Y≇

试用双4选1数据选择器74153和少量门设计一个有4个输入X₃、X₂、X₁、X₀和2个输出Y₁、Y₀的逻辑电路.电路输入为余3BCD码,输出为用2位二进制数表示的输入码中“1”的个数,例如,当输入X₃X₂X₁X₀=1010时,输出Y₁Y₀=10.当非余3码(伪码)输入时,要求输出Y₁Y₀=00.要求写出设计过程,画出电路图(规定X₃、X₂分别和数据选揮器地址码的高、低位相连接,74153的逻辑符号和功能表分别如图10.43和表10.6所示).

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第3题

在FX3U系列的PLC中,高速计数器C251是对以下哪个输入进行高速计数的（）

A.X1，X2

B.X0，X1

C.X0，X2

D.X2，X3

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第4题

设计一个单脉冲发生器。两个输入为x₁，x₂输出z，其中x₁为连续的脉冲信号，x₂为一

个开关信号，要求当入从高跳变到低后，z输出一个完整的x₁脉冲，并只有在输出二变低以后，x₂才能再次由低到高.其波形如下图所示。

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第5题

信号x(t)用采样周期T经过一个零阶保持的处理产生一个信号x0(t)，设x1 (t)是在x(t)的样本上经过

信号x（t)用采样周期T经过一个零阶保持的处理产生一个信号x0（t)，设x1 （t)是在x（t)的样本上经过

一阶保持处理的结果，即

其中hy(t1)是如图7-2所示的函数。试给出一个滤波器的频率响应，当输入为x0(t)时，该滤波器产生的输出为

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第6题

根据下列问题，列出其真值表，并写出逻辑表达式:(1) 有A、B、C三个输入信号，当三个输入信号均为0，或其中有两个为1时，输出F=1，其余情况F=0。(2) 有A、B、C三个输入信号，当三个输入信号中出现奇数个1时，输出F=1，其余情况F=0。

根据下列问题，列出其真值表，并写出逻辑表达式:（1) 有A、B、C三个输入信号，当三个输入信号均为0，或其中有两个为1时，输出F=1，其余情况F=0。（2) 有A、B、C三个输入信号，当三个输入信号中出现奇数个1时，输出F=1，其余情况F=0。

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第7题

或非门逻辑关系的特点是：只有当两个输入端都为高电平时，输出端才为高电平；只要有一个输入端是高电平，输出端就输出低电平。（）

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第8题

用VHDL设计一个串行码流转换电路，一组4位8421码(LSB先输入)从X₁输入，在输入第1个数码(LSB)时，字同步信号X₂=1，表示一个字(4位)输入开始.该电路能够将输入的8421码转换为余3码输出(LSB先输出)。

用VHDL设计一个串行码流转换电路，一组4位8421码（LSB先输入)从X₁输入，在输入第1个数码（LSB)时，字同步信号X₂=1，表示一个字（4位)输入开始.该电路能够将输入的8421码转换为余3码输出（LSB先输出)。

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第9题

设计一个串行4位奇偶枚验电路，一组4位数码从X₁输入，输入到第4个数码时。字同步信号X₂=1，表示一个字(4位)输入结束，当4个数码中的"1"的个数为奇数时，输出Z=1，否则输出为0。

设计一个串行4位奇偶枚验电路，一组4位数码从X₁输入，输入到第4个数码时。字同步信号X₂=1，表示一个字（4位)输入结束，当4个数码中的"1"的个数为奇数时，输出Z=1，否则输出为0。

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第10题

已知的一个近似值x₀=1.414，用牛顿迭代法计算x₁(保留6位小数),并与精确值比较.

已知的一个近似值x₀=1.414，用牛顿迭代法计算x₁（保留6位小数),并与精确值比较.

已知的一个近似值x₀=1.414，用牛顿迭代法

计算x₁(保留6位小数),并与精确值比较.

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