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[主观题]

试用2个D触发器设计一个四相时仲发生器,所谓四相时钟发生器足指它产生4个相互相差90度的脉冲信号,要求阿出原理图和输出波形图。

试用2个D触发器设计一个四相时仲发生器,所谓四相时钟发生器足指它产生4个相互相差90度的脉冲信号,要求阿出原理图和输出波形图。

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第1题

试用D触发器和少量门设计一个能产生序列信号为0001101的移存型序列信号发生器.

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第2题

试用JK触发器设计一个三相六拍脉冲分配器.分配器的输出波形如图5-56所示.

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第3题

单纯采取保护接地措施适用于()电网

A.三相三线制

B.三相四线制

C.四相三线制

D.四相四线制

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第4题

试设计一个能产生011100111001110的序列脉冲发生器.

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第5题

设计一个序列信号发生器,该序列信号发生器产生的序列信号为0100111。

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第6题

图21.44所示电路是一个可以产生几种脉冲波形的信号发生器,试从所给出的时钟脉冲CP画出Y1,Y
2,Y3三个输出端的波形。设触发器的初始状态为“0”。

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第7题

试用JK触发器设计一个同步4进制计数器,它有2个控制端,其功能如下:
试用JK触发器设计一个同步4进制计数器,它有2个控制端,其功能如下:

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第8题

试用一个3位异步二进制计数器和一个3-8详码器,构成一个顺序脉冲发生器,要求画出原理图和输出波形图。

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第9题

试用D触发器设计一个同步时序电路,能够满足下列状态转换图要求。

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第10题

试用4个负边沿触发的JK触发器构成一个异步二进制加法计数器,要求画出逻辑图和输出波形。

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