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用JK触发器设计一个同步六进制加1计数器。

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第1题

用边沿JK触发器设计一个同步三进制减法计数器,状态图如图5-95所示.试回答下列问题: (1)最少用
用边沿JK触发器设计一个同步三进制减法计数器,状态图如图5-95所示.试回答下列问题: (1)最少用

用边沿JK触发器设计一个同步三进制减法计数器,状态图如图5-95所示.试回答下列问题:

(1)最少用几个触发器?

(2)列出状态表;

(3)求出最简驱动方程:

(4)画出逻辑电路图;

(5)检查能否自启动。

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第2题

试用JK触发器设计一个同步七进制计数器,当计满时输出一个0.

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第3题

试用JK触发器设计一个同步4进制计数器,它有2个控制端,其功能如下:
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第4题

用下降沿触发的边沿JK触发器和与非门,设计一个按自然态序进行计数的七进制同步加法计数器。

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第5题

试用JK触发器设计一个可控计数器,当控制信号M=0时工作在五进制,当M=1时工作在六进制。

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第6题

试用边沿JK触发器和门电路设计一个按自然态序进行计数的七进制同步加法计数器。

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第7题

用JK触发器设计一个同步时序电路,状态表如下。

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第8题

试用JK触发器设计一个8421BCD计数器。

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第9题

用VHDL设计一个可控进制的同步计数器,当控制端M=0时为10进制计数器,控制端M=1时为12进制计数器。
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第10题

用T触发器作为存储元件,设计一个采用8421码的十进制加1计数器。

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